▷ SOLUCIÓN EVALUACIÓN SISTEMAS DIGITALES 2, Mejoramiento (2022 PAO 2)
- ➡️ #DigitalSystems #DigitalElectronic #DigitalCircuits #HDL #VHDL #FPGA
- ⭐ https://github.com/vasanza/MSI-VHDL
Se desea diseñar un Sistema Digital controlado por una Maquina Secuencial Sincrónica (MSS), la misma que deberá contar la cantidad de números pares que se encuentran almacenados en una memoria RAM de 255 direcciones. Los números almacenados en la memoria RAM serán de 8 bits y fueron generados de forma aleatoria, es decir que serán números entre 0 y 255. Dada la aleatoriedad con la que fueron generados los números, asuma que pueden estar repetidos en algunos casos.
El sistema ya cuenta con los números almacenados en la memoria RAM. Para empezar el conteo de números pares, la MSS deberá recibir un valor de uno en la señal de entrada “Start” (Start = 1) y la MSS indicará por medio de la señal de salida “Fin” el momento en que finalice el conteo de números pares almacenados en la memoria RAM (Fin = 1). Si se quiere regresar al estado inicial para realizar una nueva búsqueda, la MSS deberá recibir un valor de uno en la señal de entrada “OK” (OK = 1). El sistema digital deberá presentar el resultado del conteo en tres display de 7 segmentos (centenas, decenas y unidades).
El siguiente seudocódigo ejemplifica el funcionamiento del sistema digital:
- a) Elaborar la partición funcional del circuito completo incluyendo la memoria RAM, contadores up, multiplexores, comparadores, registros de sostenimientos, decodificadores de 7 segmentos, puertas lógicas necesarias, asuma que existe el bloque MSI que entrega las Centenas, Decenas y Unidades. [x%]
- b) Completar los pines faltantes de la MSS para que controle todos los boques MSI de la partición funcional implementada en el punto anterior. [x%]
- c) Elaborar el ASM de la MSS, para que el circuito realice la tarea solicitada. [x%]
Resolución:
a)
b)
c)
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